Creating standard VHDL test environments

   
   

A method, a data structure, a computer program product and a computer for testing digital designs defining integrated circuits in a HDL before actually building the integrated circuits and, more specifically, for creating standard test environments for digital designs. One embodiment provides a method of creating an entity description for use in an automated testing environment, the entity description defining an entity of an integrated circuit in a hardware description language, the entity of the integrated circuit comprising at least one interface having a plurality of ports each associated with a pre-determined function. The method comprises, for at least one port of the plurality of ports, associating at least one indication of a specific procedure call with the at least one port, the specific procedure call defining the pre-determined function of the at least one port.

Un metodo, una struttura di dati, un prodotto di programma destinato all'elaboratore e un calcolatore per verificare i disegni digitali che definiscono i circuiti integrati in un HDL prima realmente della costruzione dei circuiti integrati e, specificamente, per la generazione degli ambienti standard della prova a disegni digitali. Un incorporamento fornisce un metodo di generazione della descrizione dell'entità per uso in un ambiente difficile automatizzato, la descrizione dell'entità che definisce un'entità di un circuito integrato in una lingua di descrizione dei fissaggi, l'entità del circuito integrato che contiene almeno un'interfaccia che ha una pluralità di orificii ciascuno connessa con una funzione predeterminata. Il metodo contiene, per almeno un orificio della pluralità di orificii, associante almeno un'indicazione di una chiamata specifica con il almeno un orificio, la chiamata specifica di procedura di procedura che definisce la funzione predeterminata del almeno un orificio.

 
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