Apparatus for performing bit sensitive parallel bus peer addressing

   
   

Methods and apparatus used in systems for communicating data (e.g., voice, video and alphanumeric data), including but not limited to telecommunications systems, computer systems, to efficiently utilize bandwidth by performing bit sensitive peer addressing. Apparatus (and related methods) for performing bit sensitive peer addressing include a parallel bus of data bits, a clock bit, a bid/busy bit, and an ack bit. The invention further includes a plurality of port devices coupled to the bus. Each port device includes bus interface circuitry, port control circuitry, and line interface circuitry. The clock signal is used to synchronize messages on the bus and to divide the time domain into timeslots (one timeslot being the reciprocal of the clock frequency). According to the invention, no frame reference is used and traffic on the bus is controlled using a protocol. Each port has an address which is one of the data bits of the bus. Ports bid for access to the bus by asserting their data line and the bid/busy line whenever the bid/busy line is not asserted by another. After seizing the bus, a source port keeps the bid/busy line asserted until it is done transmitting. When two or more ports bid for bus access at the same time, access is given to the port with the highest priority. According to a preferred embodiment of the invention priority is associated with the bit number.

Métodos y aparato usados en los sistemas para los datos de los datos que se comunican (e.g., voz, video y alfanumérico), incluyendo pero no limitados a las telecomunicaciones los sistemas, sistemas informáticos, para utilizar eficientemente anchura de banda realizando la dirección sensible del par del pedacito. Los aparatos (y métodos relacionados) para realizar la dirección sensible del par del pedacito incluyen un autobús paralelo de bits de datos, de un pedacito del reloj, de un pedacito de bid/busy, y de un pedacito del ack. La invención más futura incluye una pluralidad de dispositivos portuarios juntados al autobús. Cada dispositivo portuario incluye el trazado de circuito del interfaz de autobús, el trazado de circuito portuario del control, y la línea trazado de circuito del interfaz. Se utiliza la señal del reloj para sincronizar mensajes en el autobús y de dividir el dominio de tiempo en los timeslots (un timeslot que es el recíproco de la frecuencia de reloj). Según la invención, no se utiliza ninguna referencia de marco y el tráfico en el autobús es controlado con un protocolo. Cada puerto tiene una dirección que sea uno de los bits de datos del autobús. Los puertos hacen una oferta para el acceso al autobús afirmando su línea de datos y la línea de bid/busy siempre que la línea de bid/busy no sea afirmada por otra. Después de agarrar el autobús, un puerto de la fuente mantiene la línea de bid/busy afirmada hasta que es el transmitir hecho. Cuando dos o más puertos hacen una oferta para el acceso del autobús en el mismo tiempo, el acceso se da al puerto con la prioridad más alta. Según una encarnación preferida de la invención la prioridad se asocia al número de pedacito.

 
Web www.patentalert.com

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